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LDO와 CDC3S04YFFR 클록 타이머 ICS 시계 구동기와 배포 쿼드 사인파 클럭 버퍼

제조 업체:
제조업자
기술:
IC CLK 버퍼 1:4 52MHZ 20DSBGA
범주:
플래쉬 메모리 IC 칩
가격:
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결제 방법:
페이팔, 웨스턴 유니온, TT
상술
맥스 출력 Freq:
52MHz
공급 전압 - 맥스:
2.5V
공급 전압 - 민:
- 0.5 V
최소 동작 온도:
- 40 C
최대 작업 온도:
+ 85 C
최대 입력 신호 주파수:
52MHz
하이라이트:

timer ic chip

,

time delay ic chip

도입

LDO와 CDC3S04YFFR 클록 타이머 ICS 시계 구동기와 배포 쿼드 사인파 클럭 버퍼

특징

  • 1시 4분 저 지터 클럭 버퍼

  • 단일 단자 사인파 시계 입출력

  • 극히 낮은 위상 노이즈와 대기 전류

  • 각각 출력을 위한 개별적 시계 요청 입력

  • 낮은 소음 TCXO 공급을 위한 온칩 저탈락 생산량 (LDO)

  • 일련 I2C 인터페이스 (높은 속도 모드, 3.4 메가비트 / S와 호환기)

  • 1.8-V 디바이스 전원은 공급합니다

  • 넓은 온도 영역, 85' C에 대한 -40' C

  • ESD 보호 : 2 KV HBM과 750 V CDM과 100 V MM

  • 작은 20-핀 칩-스케일 패키지 : 0.4 밀리미터 피치 WCSP (1.6 밀리미터 × 2 밀리미터)

애플리케이션

  • 휴대폰

  • 스마트 폰

  • 이동핸드셋

  • 가지고 다닐 수 있는 시스템

  • GPS와 WLAN, W BT, 디지털 tv, DVB-H, FM 라디오, 와이맥스와 시스템 클럭을 포함하는 무선 모뎀

기술

CDC3S04는 4채널 저동력 저 지터 사인파 클럭 버퍼입니다. 그것은 다중 주변장치에 단일의 마스터 시간을 버퍼링하는데 사용될 수 있습니다. 4개 사인파 출력 (CLK1-CLK4)는 최소 채널-채널 스큐와 극히 낮은 부가적 출력 지터를 위해 설계됩니다.

각각 출력은 헌신적 클록 출력을 가능하게 하는 그것의 자체 클럭 요청 입력을 가지고 있습니다. 이러한 클럭 요청은 액티브-하이 (또한 I2C를 통해 액티브-로우라는 것 바뀔 수 있는 ) 이고 시계 (MCLK_REQ)를 요구하기 위해 마스터 클럭으로 반송할 수 있는 출력 신호가 발생됩니다. mckl_req는 열린 소스 출력이고, 연결 논리합 기능 (디폴트 모드)을 지원합니다. 그것은 외부 풀다운 레지스터를 필요로 합니다. mckl_req는 I2C를 통해 와이어드 AND 또는 추진 당기기 기능성으로 변경될 수 있습니다.

CDC3S04는 또한 출력을 가능하게 하거나 무력하게 하고, REQ 입력의 극성을 선택하고, 내부 디코딩의 통제를 허락하는데 사용될 수 있는 I2C 인터페이스 (Hs 모드)를 제공합니다.

CDC3S04는 2.3 V부터 5.5 V까지 전압을 받아들이고, 1.8-V 공급을 출력하는 온칩으로 고성능 LDO를 특징으로 합니다. 이 1.8-V 공급은 외부 1.8-V TCXO를 강화하는데 사용될 수 있습니다. 그것은 TCXO에 전력 절감을 위해 가능해지거나 무력하게 될 수 있습니다.

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