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16 28-리드 TSSOP AD7490BRUZ의 순차기와 채널 1 MSP 12-비트 ADC

제조 업체:
제조업자
기술:
12 비트 AD 변환기 16 입력 1 전자파 인체 흡수율 28-tssop
범주:
집적 회로 칩
가격:
Negotiate
결제 방법:
전신환, 웨스턴 유니온, 페이팔
상술
국민 총수요에 대한 VDD:
+7 V에 대한 -0.3 V
국민 총수요에 VDRIVE:
VDD + 0.3 V에 대한 -0.3 V
국민 총수요에 대한 아날로그 입력 전압:
VDD + 0.3 V에 대한 -0.3 V
국민 총수요에 대한 디지털 입력 전압:
+7 V에 대한 -0.3 V
국민 총수요에 대한 디지털 출력 전압:
VDD + 0.3 V에 대한 -0.3 V
국민 총수요에 REFIN:
VDD + 0.3 V에 대한 -0.3 V
Supplies1 를 제외한 어떠한 핀에 대한 입력전류:
±10 마
보존온도범위:
+150' C에 대한 -65' C
하이라이트:

electronic chip board

,

electronic components ic

도입

16-채널, 1 MSP, 28-리드 TSSOP의 순차기와 12-비트 ADC

특징

빠른 출력율 : 1 MSP

2.7 V에서 5.25 V의 VDD를 위해 상세화됩니다

최대 출력율로 저 소비 전력

5.4 3번 V 공급과 870 크스프스에 있는 mW 최대

12.5 5번 V 공급과 1 MSPS에 있는 mW 최대

순차기와 16 (단일 단자) 입력

넓은 입력 대역폭

50개 킬로 헤르츠 입력 주파수로 69.5 dB SNR

굴신력 / 시리얼 클락 속도 운용

어떤 파이프라인 지연

고속 직렬 인터페이스, 적합한 SPI/QSPITM/MICROWIRETM/ DSP

가득 찬 셧다운 모드 : 0.5 uA 최대

28은 TSSOP을 이끌고 32가 LFCSP 패키지를 이끕니다

기능블록도표

일반 설명

AD7490은 12 비트 고속도, 저 소비 전력, 16개 채널, 순차 근사 ADC입니다. 부품은 한 개의 2.7 V에서부터 5.25 V 전원 공급기까지 작동하고, 1 MSPS까지 출력율을 특징으로 합니다. 일부는 1 마하즈를 초과하여 입력 주파수를 취급할 수 있는 저소음, 광대역폭 트랙-홀드 증폭기를 포함합니다.

쉽게 기기가 마이크로프로세서 또는 DSP와 연결될 수 있게 허락하면서, 변환 과정과 데이터 수집은 CS와 시리얼 클럭 신호를 사용하여 제어됩니다. 입력 신호는 CS의 하강 모서리에서 견본으로 추출되고 변환이 또한 이 시점에서 착수됩니다. 부분과 관련된 어떤 파이프라인 지연이 없습니다.

AD7490은 높은 출력율로 저출력 소실을 매우 달성하기 위해 최신 설계 기법을 이용합니다. 최대 출력율을 위해, AD7490은 3번 V 공급과 1.8 마와 5번 V 공급과 2.5 마를 단지 소비합니다.

명령 레지스터에서 관련 비트에서 설정함으로써, 나름대로 아날로그 입력 범위는 또한 순수 2진법 또는 두 출력된 보수 코딩으로, REFIN 입력에 대한 0 V 또는 2 × REFIN 입력에 대한 0 V라는 것 선택될 수 있습니다. AD7490은 채널 중에서 미리 프로그램된 선택이 연속적으로 전환될 수 있게 허락하기 위해 채널 순차기와 16개의 단일 단자 아날로그 입력을 특징으로 합니다. 이것이 변환을 제어하기 위해 또한 마스터 클럭으로서 사용되기 때문에 변환 시간은 SCLK 주파수에 의해 결정됩니다.

AD7490은 32 리드 LFCSP와 28개 리드 TSSOP 패키지에 이용할 수 있습니다.

제품 하이라이트

1. AD7490은 최고 1까지 MSPS 출력율을 제공합니다. 3번 V 공급, AD7490과 최대 정보 처리량에

전원의 5.4 mW를 단지 낭비합니다.

2. 일련의 채널은 선택될 수 있으며, AD7490이 순환하고, 변환합니다.

3. AD7490은 한 개의 2.7 V에서부터 5.25번 V 공급까지 작동합니다. VDRIVE 기능은 직렬 인터페이스를 허락합니다

또한 3 V 또는 VDD로부터 독립한 5가지 V 프로세서 시스템에 직접적으로 연결됩니다.

4. 변환 시간이 통과하여 감소될 수 있게 허락하면서, 구매 전환율은 시리얼 클락에 의해 결정됩니다

시리얼 클락 속도증가. 부분은 전력 효율을 극대화하기 위해 또한 다양한 셧다운 모드를 특징으로 합니다

더 낮은 출력율로. 소비 전력은 가득 찬 중단에서 0.5 uA, 최대입니다.

5. 일부는 샘플링 순간의 정밀 제어와 표준 순차 근사 ADC를 특징으로 합니다

CS 입력과 한때 오프 전환 제어.

절대적인 최대 RATINGS TA = 25' C, 달리 언급되지 않으면.

매개 변수 평가

국민 총수요에 대한 VDD +7 V에 대한 -0.3 V

국민 총수요에 VDRIVE VDD + 0.3 V에 대한 -0.3 V

국민 총수요에 대한 아날로그 입력 전압 VDD + 0.3 V에 대한 -0.3 V

국민 총수요에 대한 디지털 입력 전압 +7 V에 대한 -0.3 V

국민 총수요에 대한 디지털 출력 전압 VDD + 0.3 V에 대한 -0.3 V

국민 총수요에 REFIN VDD + 0.3 V에 대한 -0.3 V

Supplies1 를 제외한 어떠한 핀에 대한 입력전류 ±10 마

작동 온도 범위

상업적입니다 (비 버전) +85' C에 대한 -40' C

보존온도범위 +150' C에 대한 -65' C

접합 온도 150' C

LFCSP, TSSOP 패키지, 전력 소모 450 mW

θJA 열적 임피던스 108.2' C/W (LFCSP)

97.9' C/W (TSSOP)

θJC 열적 임피던스 32.71' C/W (LFCSP)

14' C/W (TSSOP)

납땜한 리드온도

기체상 (60 초) 215' C

적외선 (15 초) 220' C

ESD 1 kV

최고 100까지 마의 1개의 과도 전류는 SCR 래치-업을 야기시키지 않습니다.

절대 최대 정격 하에 목록화된 그것들 위의 스트레스는 장치에 대한 영구적인 손상을 일으킬 수 있습니다. 이것은 단지 스트레스 비율입니다 ; 이 상술 중에 작동 섹션에서 나타낸 그것들 위의 이러한 또는 다른 어떤 조건에 있는 장치의 기능의 운용은 의미되지 않습니다. 연장된 기간 동안 절대 최대 정격 상태에 대한 노출은 장치 신뢰도에 영향을 미칠 수 있습니다.

핀 형상과 기능 설명

핀의기능 기술

아니오 고정하세요.

TSSOP LFCSP 연상 기술

20 18 CS 칩 선택. 부 논리 논리 입력. 이 입력은 이원적인 것 제공합니다

AD7490에와 또한 변환을 착수하는 기능

시리얼 데이터 전송을 맞춥니다.

23 21 REFIN AD7490을 위한 기준 입력. 외부 기준이 아야만 합니다

이 입력에 적용되세요. 외부를 위한 전압 범위

참조는 지정 성능을 위한 2.5 V ± 1%입니다.

22 20 VDD 전력 공급 입력. AD7490을 위한 VDD 범위는 왔습니다

2.7 5.25 V에 대한 V. 2 × REFIN 범위에 대한 0 V에 대해, VDD가 어야 합니다

4.75 V부터 5.25 V 까지이세요.

14, 21, 24 12, 19, 22 AGND 아날로그 그라운드. 더 위의 모든 회로를 위한 접지 참조 지점

AD7490. 모든 아날로그 / 디지털 입력 신호와 어떠한 외부

기준 신호는 이 AGND 전압으로 참고되어야 합니다.

AGND 핀이 이어야 하는 모두는 함께 연결되었습니다.

13 내지 5, 11 내지 9, VIN15에 대한 VIN0 아날로그 입력 15를 통한 아날로그 입력 0. 단일 단자인 16

3 내지 1, 7 내지 2, 칩 내장으로 다중송신되는 아날로그 입력 채널

28 내지 25 31 내지 26, 트랙-홀드. 전환될 아날로그 입력 채널은 있습니다

24 어드레스 비트 ADD3 에서 ADD0을 이용하여 선택됩니다의

명령 레지스터. 더와 관련한, 어드레스 비트

SEQ와 투영 비트가 순차 레지스터가 있을 수 있게 허락합니다

프로그램을 짭니다. 모든 입력 채널을 위한 입력 범위가 할 수 있습니다

선택되는 것으로서 0 V에서 REFIN 또는 0 V에서부터 2 × REFIN까지 연장되세요

명령 레지스터에서 레인지비트를 통해. 어떠한 사용하지 않은 입력

채널은 소음을 피하기 위한 AGND에 연결되어야 합니다

픽업.

19 17 DIN 안에 자료를 수집하세요. 논리 입력. 명령 레지스터에 작성될 자료

AD7490의 이 입력에 제공되고,로 클러킹합니다

등록은 SCLK의 하강 모서리에 (제어를 봅니다

레지스터부).

15 13 DOUT 밖에 자료. 논리 출력. 변환은 더로부터 유래합니다

AD7490은 직렬 데이터 스트림으로서의 이 출력에 제공됩니다.

비트는 SCLK의 하강 모서리에 밖에 시간이 재지

입력. 자료 스트림은 4개의 어드레스 비트로 구성됩니다

어느 것이 변환 결과를 보내는 것을 나타내는 것 대응합니다

에게, 있는 변환 데이타의 12개 비트가 이어집니다

먼저 MSB에 의해 제공됩니다. 출력 코딩은 선택할 수 있습니다

순수 2진법 또는 2는 안에 코딩 비트를 통해 보충합니다

명령 레지스터.

16 14 SCLK 시리얼 클락. 논리 입력. SCLK는 시리얼 클락을 제공합니다

부분으로부터 데이터를 접근하기. 이 클락 입력은 또한 사용됩니다

더의 변환 과정을 위한 클럭 소스로서

AD7490.

17 15 VDRIVE 논리 전력 공급 입력. 이 핀에 공급된 전압

연속물이 조화시키는 어떤 전압에서 결정합니다 더의

AD7490은 작동합니다.

이용 불가능 EP EPAD 노출된 패드. 국민 총수요에 노출된 패드를 연결하세요.

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