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EP2S180F1020C3N 프로그래머블 로직 ICS 필드 프로그래머블 게이트 어레이 FPGA - 스트라티스 0 랩스 742 IOs

제조 업체:
제조업자
기술:
Stratix® II 필드 프로그래머블 게이트 어레이 (FPGA) IC 742 9383040 179400 1020-bbga, FCBGA
범주:
플래쉬 메모리 IC 칩
가격:
Contact us
결제 방법:
페이팔, 웨스턴 유니온, TT
상술
논리소의 번호:
179400
로직 어레이 블럭 - 랩스의 수:
8970
I/Os의 수:
742 입출력
작동 공급 전압:
1.2 V
최소 동작 온도:
0 C
최대 작업 온도:
+ 70 C
하이라이트:

logic integrated circuits

,

programmable logic array ic

도입

EP2S180F1020C3N 프로그래머블 로직 ICS 필드 프로그래머블 게이트 어레이 FPGA - 스트라티스 0 랩스 742 IOs

특징

  • 15,600 내지 179,400 동등한 르 ; 표 1-1을 보세요

  • 새롭고 혁신적 적응할 수 있는 논리 모듈 (ALM), 기초적인 것

    스트라티스 II 건축의 구성 요소가 성능을 극대화합니다

    그리고 자원 사용 효율

  • 최고 9,383,040까지 RAM은 없이 이용 가능한 (1,172,880 바이트)를 억제합니다

    논리 리소스를 감소시키기

  • 구현하기 위한 세 RAM 블록 크기로 구성되는 트리마트릭스 메모리

    사실인 이중 포트 기억 장치와 선입선출 (FIFO)는 버퍼링합니다

  • 고속 DSP 블록은 헌신적 실행을 제공합니다의

    최고 450까지 마하즈), 다중-축적 기능 (에서의 곱셈 장치 . 그리고

    유한 임펄스 응답 (전나무 재목) 필터

  • 디바이스 영역 당 24가지 시각재기 자원과 최고 16까지 글로벌클럭

  • 클록 제어 블록은 동적 클럭회로망 실행 / 드이사벨을 지원합니다,

    그것이 전원을 내림에 대한 클럭회로망이 전력을 줄일 수 있게 허락합니다

    사용자 모드로 소모

  • 장치 당 최고 12까지 PLL (네 강화한 PLL과 여덟 빠른 PLL)

    확산 스펙트럼, 프로그램가능 대역폭, 위에 클럭 스위치, 실시간 PLL 재구성과 진보적 증가와 위상 쉬프팅을 제공하세요

  • 수많은 단일 단자이고 차별적 입출력 표준을 지원하세요

  • 고속 차별적 입출력은 1-gbp를 위한 DPA 회로와 함께 지지합니다

    성능

  • 고속 네트워킹과 통신 버스를 지원하세요

    평행한 라피디오, SPI-4 단계 2 (POS-PHY를 포함하는 표준

    수준 4)히페트랜스포트티엠 기술과 SFI-4

  • DDR와 DDR2를 포함하여, 고속 외부 메모리를 지원하세요

    SDRAM, RLDRAM II, QDR II SRAM과 SDR SDRAM

  • 다수 지적재산권 메가펑션을 지원합니다로부터

    알테라 MegaCore® 기능과 알테라 메가펑션 파트너들

    (AMPPSM) 메가펑션의 프로그램을 짜세요

  • 구조 비트스트림을 사용하여 설계 안보를 지원하세요

    암호화

  • 멀리 있는 환경 설정 갱신을 지원하세요

표 1-1. 스트라티스 II FPGA 가족 특징

특징

EP2S15

EP2S30

EP2S60

EP2S90

EP2S130

EP2S180

ALM

6,240

13,552

24,176

36,384

53,016

71,760

적응할 수 있는 룩업 테이블 (ALUTs) (1)

12,480

27,104

48,352

72,768

106,032

143,520

동등한 LEs (2)

15,600

33,880

60,440

90,960

132,540

179,400

M512 램형 블럭

104

202

329

488

699

930

M4K RAM blocks

78

144

255

408

609

768

M-RAM 블록

0

1

2

4

6

9

전체 RAM 비트

419,328

1,369,728

2,544,192

4,520,488

6,747,840

9,383,040

DSP 블록

12

16

36

48

63

96

18개 비트 × 18 비트 곱셈 장치 (3)

48

64

144

192

252

384

강화한 피볼스

2

2

4

4

4

4

빨리 피볼스

4

4

8

8

8

8

최대 사용자 I/O 핀

366

500

718

902

1,126

1,170

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