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MT48LC32M8A2FB-75:D TR 프로그램 가능 IC 칩 동기식 DRAM 256Mb x4 x8 x16 SDRAM

제조 업체:
마이크론
기술:
SDRAM 메모리용 IC 256Mbit 대비 133 마하즈 5.4 나노 초 60 에프비지에이 (8x16)
범주:
플래쉬 메모리 IC 칩
가격:
Negotiate
결제 방법:
전신환, 웨스턴 유니온, 페이팔
상술
공급 전압:
3 내지 3.6 V
입력 최고값 전압 : 논리 1 ; 모든 입력:
VDD + 0.3 V에 대한 2
입력 저 전압 : 논리 0 ; 모든 입력:
-0.3 내지 0.8 V
입력 누설 전류 : 어떠한 입력 0V ≤ Vin ≤ VDD:
-5 내지 5 uA
“H”레벨 출력 전압 (IOUT = -4mA):
2.4 V (분)
출력 저전압 (IOUT = 4mA):
0.4 V (맥스)
하이라이트:

programming ic chips

,

programmable audio chip

도입

 

 

MT48LC32M8A2 풀그릴 IC 칩 동시 DRAM 256Mb x4 x8 x16 SDRAM

 

동기식 DRAM

MT48LC64M4A2 – 16메가 x 4 x 4 뱅크

MT48LC32M8A2 – 8메가 x 8 x 4개 뱅크

MT48LC16M16A2 – 4메가 x 16 x 4뱅크

 

특징

• PC100 및 PC133 호환

• 완전 동기식;시스템 클록의 포지티브 에지에 등록된 모든 신호

• 내부 파이프라인 운영;열 주소는 클럭 주기마다 변경될 수 있습니다.

• 행 액세스/선충전을 숨기기 위한 내부 뱅크

• 프로그래밍 가능한 버스트 길이: 1, 2, 4, 8 또는 전체 페이지

• 자동 선충전, 동시 자동 선충전 및 자동 새로 고침 모드 포함

• 자가 새로 고침 모드

• 64ms, 8,192주기 새로고침

• LVTTL 호환 입력 및 출력

• 단일 +3.3V ±0.3V 전원 공급 장치

 

옵션 마킹

• 구성

– 64Meg x 4(16Meg x 4 x 4뱅크) 64M4

– 32Meg x 8(8Meg x 8 x 4뱅크) 32M8

– 16Meg x 16(4Meg x 16 x 4뱅크) 16M16

• 쓰기 복구(WR)

WR = "2 CLK"1A2

• 플라스틱 패키지 – OCPL2

– 54핀 TSOP II OCPL2(4억) TG

(기준)

– 54핀 TSOP II OCPL2(400mil) P

무연

– 60볼 FBGA(x4, x8)(8mm x 16mm) FB

– 60볼 FBGA(x4, x8) 무연 BB

(8mm x 16mm)

– 54볼 VFBGA(x16)(8mm x 14mm) FG

– 54볼 VFBGA(x16) 무연 BG

(8mm x 14mm)

• 타이밍(주기 시간)

– 6.0ns @ CL = 3(x8, x16만 해당) -6A

– 7.5ns @ CL = 3(PC133) -75

– 7.5ns @ CL = 2(PC133) -7E

• 자가 새로 고침

– 표준 없음

– 저전력 L

• 작동 온도 범위

– 상업용(0°C ~ +70°C) 없음

– 산업용(–40°C ~ +85°C) IT

• 디자인 수정 : D

 

참고: 1. Micron 기술 참고 사항: TN-48-05를 참조하십시오.

2. 중심에서 벗어난 분리선.

3. 사용 가능 여부는 Micron에 문의하십시오.

 

일반적인 설명

256Mb SDRAM은 268,435,456비트를 포함하는 고속 CMOS 동적 랜덤 액세스 메모리입니다.내부적으로 동기식 인터페이스가 있는 쿼드 뱅크 DRAM으로 구성됩니다(모든 신호는 클록 신호의 양의 에지인 CLK에 등록됨).x4의 각 67,108,864비트 뱅크는 8,192행 x 2,048열 x 4비트로 구성됩니다.x8의 각 67,108,864비트 뱅크는 8,192행 x 1,024열 x 8비트로 구성됩니다.x16의 각 67,108,864비트 뱅크는 8,192행 x 512열 x 16비트로 구성됩니다.

SDRAM에 대한 읽기 및 쓰기 액세스는 버스트 지향적입니다.액세스는 선택한 위치에서 시작하여 프로그래밍된 순서대로 프로그래밍된 위치 수만큼 계속됩니다.액세스는 READ 또는 WRITE 명령이 뒤따르는 ACTIVE 명령의 등록으로 시작됩니다.ACTIVE 명령과 일치하여 등록된 주소 비트는 액세스할 뱅크 및 행을 선택하는 데 사용됩니다(BA0, BA1은 뱅크 선택, A0–A12는 행 선택).READ 또는 WRITE 명령과 동시에 등록된 주소 비트는 버스트 액세스를 위한 시작 열 위치를 선택하는 데 사용됩니다.

SDRAM은 1, 2, 4 또는 8개 위치 또는 버스트 종료 옵션이 있는 전체 페이지의 프로그래밍 가능한 읽기 또는 쓰기 버스트 길이(BL)를 제공합니다.버스트 시퀀스의 끝에서 시작되는 자체 시간 행 사전 충전을 제공하기 위해 자동 사전 충전 기능을 활성화할 수 있습니다.

256Mb SDRAM은 내부 파이프라인 아키텍처를 사용하여 고속 작동을 달성합니다.이 아키텍처는 프리페치 아키텍처의 2n 규칙과 호환되지만 매 클록 주기마다 열 주소를 변경하여 고속의 완전 랜덤 액세스를 달성할 수도 있습니다.다른 3개 뱅크 중 하나에 액세스하는 동안 하나의 뱅크를 미리 충전하면 PRECHARGE 주기가 숨겨지고 끊김 없는 고속 랜덤 액세스 작업이 제공됩니다.

256Mb SDRAM은 3.3V 메모리 시스템에서 작동하도록 설계되었습니다.절전, 절전 모드와 함께 자동 새로 고침 모드가 제공됩니다.모든 입력 및 출력은 LVTTL과 호환됩니다.

SDRAM은 자동 열 주소 생성을 통해 높은 데이터 속도로 데이터를 동기식으로 버스트하는 기능, 사전 충전 시간을 숨기기 위해 내부 뱅크 사이를 인터리빙하는 기능, 각각의 열 주소를 임의로 변경하는 기능을 포함하여 DRAM 작동 성능을 크게 향상시킵니다. 버스트 액세스 동안 클록 주기.

 

64Meg x 4 SDRAM 기능 블록 다이어그램

 

 

32Meg x 8 SDRAM 기능 블록 다이어그램

 

 

16Meg x 16 SDRAM 기능 블록 다이어그램

 

 

 

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