새로운 MC9S08LC60LK 집적 회로 칩 & 원형 마이크로컨트롤러
상술
Supply voltage:
–0.3 to +3.8 V
Maximum current into VDD:
120 mA
Digital input voltage:
–0.3 to VDD + 0.3 V
Instantaneous maximum current:
± 25 mA
Storage temperature range:
–55 to 150 °C
Operating temperature:
-40 to 85 °C
하이라이트:
digital integrated circuits
,linear integrated circuits
도입
MC9S08LC60 특징
8-비트 HCS08 중앙처리장치 (CPU)
- 40-MHz HCS08 CPU
- HC08 교육은 추가된 BGND 교육과 함께 설정했습니다
- 배경 디버깅 시스템
- 회로 내 디버깅 동안 지는 단독 중단점을 허락하기 위한 (온칩 디버그 모듈에서 2 이상 브레이크포인트를 더하세요) 중단점 가능출력
- 2 비교기와 9 트리거 모드를 포함하는 내부 회로 모방기 (얼음) 오류수정 모듈. 하한가 변경 주소와 사건 유일한 데이터를 저장하기 위한 여덟 깊은 FIFO. 얼음 오류수정 모듈은 양쪽 태그와 강압 중단점을 지원합니다.
- 최고 32까지 일시정지 / 리셋 소스들을 지원하세요
메모리 옵션
- 블록 보호와 보안 옵션과 듀얼 온칩 회로내 프로그래머블 플래쉬 메모리부 ; 이용 가능한 60K와 36K 옵션
- 프로그램 /는 쉽게 지워집니다 한 순간의 어레이의 또 다른 것으로부터 실행하는 동안
- 온칩 임의 추출 기억 장치 (RAM) ; 이용 가능한 4K와 2.5K 옵션
절전 특징
- 3번 정지 외에 기다리세요
- 클럭 감시 장치의 소프트웨어 드이사벨과 가장 낮은 스탑 전류를 위한 저전압 일시정지 (LVI)
- 소프트웨어로 발생시킨 실시간 클록 (RTC)는 리얼 타임 인터럽 (RTI)를 사용하여 작용합니다
쉽게 잘 믿는 클럭 소스
- 클락 소스 옵션은 정확성 비휘발성 메모리 (NVM) 정돈으로 크리스탈, 공진기, 외부 시계 또는 내부로 클럭 생성을 포함합니다
- 자동 클락 모니터 기능
시스템 보호
- 적당히 (COP) 리셋을 운영하는 선택적 컴퓨터
- 리셋 또는 일시정지와 저전압 감지
- 리셋과 불법 조작부호 감지
패키지 옵션
- 64 핀 저자세 콰드 플랫 패키지 (LQFP)
- 80 핀 LQFP
주변 기기
- LCD (LCD 드라이버) - LCD 글라스가 드러내는 5-V 또는 3-V로 적합합니다 ; 대기와 stop3 저-전력 모드에서 기능적입니다 ; 선택 가능한 전면과 백플레인 구조 :
- - 4 X 40 또는 3 X 41 (80 pin 패키지)
- - 4 X 32 또는 3 X 33 (64 pin 패키지)
- ACMP (아날로그 비교기) - 내부 기준 전압과 비교하기 위한 선택 ; 출력은 TPM1 채널 0의 입력 포착에 운전되도록 선택 가능한 소프트웨어입니다.
- ADC (아날로그-디지털 변환기) - 8개 채널, 자동 비교 기능과 12- 비트, 비동기 클럭 관계자, 온도 센서와 내부 밴드갭 참조 채널. ADC는 RTI 반대를 사용하여 트리거할 수 있는 하드웨어입니다.
- SCI (직렬 통신장치 인터페이스) - 이용 가능한 단일 와이어 모드
- SPI1과 SPI2 - 두 일련 주변장치인터페이스모듈
- KBI - 선택 가능한 상승하거나 떨어지는 모서리가 발견한 소프트웨어와 2시 8분 핀 키보드 인터럽트 모듈
- IIC - 최대 버스 로드와 100 킬로보우에 달하는 작동을 할수 있는 내부통합 회로 버스 모듈 ; 감소된 로딩으로 더 높은 보오레이트를 할 수 있습니다
- TPM1과 TPM2 - 선택 가능한 입력 캡쳐와 출력 비교와 각각 채널 위의 가장자리 정렬 PWM 역량과 두 타이머 / 펄스 폭비. 각각 타이머 모듈은 온채널에 버퍼링된, 중심 PWM (CPWM)에 대해 구성될 수 있습니다.
입출력
- 최고 24까지 다목적 입출력 (I/O) 핀 ; 2 출력 전용 핀과 한 입력전용 핀을 포함합니다
- 입력으로서 사용될 때 공항 위의 소프트웨어 선택 가능 풀업. 선택은 개별적 포트 비트 원칙에 있습니다.
- 출력한 것처럼 사용되 (선택이 개별적 포트 비트 원칙에 있습니다) 때 포트에 대한 소프트웨어 선택 가능한 슬루 레이트 제어
- 출력한 것처럼 사용될 때 소프트웨어 선택 가능한 구동 세기는 공항에 제어됩니다 (선택이 개별적 포트 비트 원칙에 있습니다)
- 리셋과 나누기 요구 위의 내부 pull-up은 고객 시스템 비용을 줄이기 위해 고정합니다
절대 최대 정격
평가 | 기호 | 가치 | 유닛 |
공급 전압 | VDD | +3.8에 대한 -0.3 | V |
VDD로의 최대 전류 | 국제 다이얼 | 120 | 마 |
디지털 입력 전압 | VIn | VDD + 0.3에 대한 -0.3 | V |
즉석 최대 전류 단일 핀은 (모든 포트 핀에 적용되) (1), (2), (3)를 제한합니다 |
ID | ± 25 | 마 |
보존온도범위 | 트스트그 | -55 내지 150 | 'C |
- 입력은 현재인 채 상세화된 가치로 제한됩니다. 요구 전류 제한 저항의 값을 측정하기 위해, (VDD) 긍정적의 저항값과 부정적 (VSS) 클램프 전압을 산정하고 2 저항값의 더 큰 것을 사용하세요.
- 모든 기능적 미공급 핀은 내부로 VSS와 VDD에 고정됩니다.
- 전원 공급기는 즉석이고 최대 현재 상황을 운영합니다 동안 VDD 사거리를 운영하는 것 내에 규제를 유지하여야 합니다. 만약 양화 주입 전류 (VIn > VDD)가 국제 다이얼보다 더 크면, 주입 전류가 VDD에서 흘러나올 수 있고, 규제를 빠져나가는 외부 전력 공급 장치의 결과가 될 수 있었습니다. 외부 VDD 로드가 최대 주입 전류 보다 현재인 커서 빗나갈 것이라는 것을 보증하세요. 이것은 MCU가 소비 전력이 아닐 때 최대 위기일 것입니다. 예는 다음과 같습니다 : 어떤 시스템 클럭도 참석하지 않으면, 또는 어느 것이 소비를 전체 전력을 줄이는 클락 레이트가 매우 낮으면.
형태 1. 80-핀 LQFP 패키지에서 MC9S08LC60 시리즈
형태 2. 64-핀 LQFP 패키지에서 MC9S08LC60 시리즈
기록 : VREFH / VREFL은 내부로 64 pin 패키지에서 VDDAD / VSSAD에 연결됩니다.
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